西門子發布下一代全面硬件輔助驗證系統

作者： 2021年04月25日來源：瀏覽量：

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日前，西門子數字化工業軟件宣布推出下一代Veloce™硬件輔助驗證系統，可以快速驗證高度復雜的下一代集成電路(IC)設計。該系統是完整的集成式解決方案，將虛擬平臺、硬件仿真和FPGA原型驗證

　　日前，西門子數字化工業軟件宣布推出下一代Veloce™ 硬件輔助驗證系統，可以快速驗證高度復雜的下一代集成電路(IC)設計。該系統是完整的集成式解決方案，將虛擬平臺、硬件仿真和FPGA原型驗證技術融于一身，為應用硬件輔助驗證的新方法奠定了堅實基礎。

　　Veloce硬件輔助驗證系統中的新產品包括：

　　用于虛擬平臺/軟件激活驗證的Veloce HYCON(HYbrid CONfigurable)。Veloce HYCON提供了一種創新技術，能夠幫助客戶為其下一代SoC(System-on-Chip)設計和部署復雜的混合仿真系統。

　　Veloce Strato+ — Veloce Strato硬件仿真器的容量升級版本。憑借可擴展至150億門電路的能力，Veloce Strato+不僅具備業內較高的總處理容量，同時能夠將其與較快的協同模型帶寬和可見性速度相結合，發揮最大功用。

　　Veloce Primo企業級FPGA原型驗證系統。這是一款自主研發的企業原型設計解決方案，其結合了業界運行性能與快速的原型起動。

　　Veloce proFPGA桌面FPGA原型驗證系統。Veloce proFPGA系列產品采用模塊化的容量方案，可以根據不同的容量需求提供相應的可擴展性。

　　此次發布的系統高度集成，為硬件輔助驗證方法的發展方向設立了新標準。該系統可以簡化并優化驗證周期，同時能夠降低驗證成本，以此將硬件、軟件和系統驗證的智能數字化提至更高水平。

　　這種無縫管理驗證周期方法強調在驗證周期的早期階段去運行市場特定的實際工作負載、框架和基準測試，以進行功耗和性能分析。通過這樣的方式，客戶可以在開發初期構建虛擬的 SoC 模型并進行整合，在Veloce Strato+ 上運行實際的固件和軟件，從而深入了解硬件的最低層。隨后，客戶可以將相同的設計轉移到Veloce Primo中，以更接近實際系統的速度運行，藉此驗證軟件/硬件接口并執行應用程序級軟件。為了使這種方法盡可能高效，Veloce Strato+和Veloce Primo使用相同的RTL、相同的虛擬驗證環境、相同的交易器(transactor)和模型，能夠最大限度地重用驗證材料、環境和測試內容，進而為無縫方法的實施提供必要基礎。

　　Siemens EDA 高級副總裁兼總經理Ravi Subramanian表示：“隨著我們進入新的半導體景氣周期，以軟件為中心的SoC設計帶來了功能性驗證系統的根本改變，以滿足更高需求。下一代Veloce系統應運而生，這是西門子不斷投資、專注于客戶需求的直接成果，現在我們可以為客戶提供一個完整的集成系統，為未來十年制定了清晰的技術路線圖。此次產品的發布標志著我們正在建立新的系統標準，使其能夠滿足計算、存儲、人工智能/機器學習、5G、網絡和汽車等不同行業的驗證要求。”

　　Veloce硬件輔助驗證系統得到擴展的關鍵所在

　　芯片、系統和軟件設計方面的創新，使得Veloce Strato+ 實現了2017年推出Veloce Strato平臺時發布的容量路線圖。由于全新專有的 2.5D 芯片 — Crystal 3+ 的創新設計與制造，使系統容量比之前的 Veloce Strato 系統提高了1.5倍。這一創新使Veloce Strato+ 能夠以 150 億門電路的容量占據仿真市場地位，這是當今市場上比較高的有效容量，現已被多家 Veloce Strato+ 客戶采用。

　　AMD企業院士兼方法架構師Alex Starr表示：“AMD在晶片驗證和確認解決方案中采用了Veloce仿真平臺。我們開發的高性能設計需要使用可擴展、可靠、創新的仿真解決方案，我們十分高興能夠與西門子合作，在AMD率先部署大容量Veloce Strato+系統。此外，我們也非常高興看到我們第二代和第三代AMD EPYC™ 處理器可以用于Veloce Strato和Veloce Strato+平臺。這兩個處理器系列的高性能可以為Veloce生態系統及包括AMD在內的客戶帶來更高的設計生產力。”

　　Veloce Strato系統還增加了AMD EPYC™ 7003系列作為合資格處理器，這些新處理器可以作 Veloce Strato系統的運行主機和協同模型主機。

　　Veloce Primo和Veloce proFPGA是目前業界強大、通用的FPGA原型解決方案。企業級FPGA原型系統Veloce Primo可提供出色的性能，容量能夠擴展至320個FPGA，并在軟件工作負載、設計模型和前端編譯技術方面，采用與 Veloce Strato一致的工作模型。這種硬件仿真和原型驗證之間的基本一致性將有助于降低驗證成本，通過使用正確工具將仿真和原型驗證彼此互補，可在最短的周期內獲得較好結果。Veloce Primo還支持虛擬(仿真卸載)和ICE(In-Circuit Emulation)使用模型，可在兩種模式下保持準確的時鐘比率，實現高性能。

　　Arm 設計服務高級總監Tran Nguyen表示：“各行各業不斷增長的計算需求意味著更短的上市時間，西門子的Veloce Primo企業級FPGA原型解決方案能夠幫助Arm迅速解決設計問題，并實現驗證目標，使我們的生態系統可以開發出基于Arm的高質量SoC，從而加速創新步伐。”

　　賽靈思核心垂直市場高級總監Hanneke Krekels表示：“我們很高興看到西門子為FPGA原型驗證市場推出Veloce Primo。賽靈思與西門子建立了長期的客戶與合作伙伴關系，我們業界Virtex UltraScale+ VU19P 最新設備可以助力西門子的這款新產品組合實現優秀的可擴展性和容量。”

　　西門子同時與Pro Design簽訂了一項OEM協議，使Veloce proFPGA為Veloce硬件輔助驗證系統提供成熟桌面平臺。Veloce proFPGA 系列產品采用模塊化的容量方案，可采用Intel Stratix 10 GX 10M和 Virtex UltraScale+ VU19P的高端FPGA，滿足從4000萬門到8億門的多種容量擴展需求。

　　Pro Design首席執行官Gunnar Scholl表示：“proFPGA系列的先進技術可為當今的人工智能/機器學習、5G和數據中心ASIC設計的驗證工作帶來諸多優勢。我們對 FPGA桌面原型設計市場的經驗、見解和策略正在獲得認可，我們期待此次與西門子的合作能夠加速雙方在這一領域的市場滲透。”

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